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CAT28F512
Figure 5. Chip Erase Algorithm (1)
START ERASURE
APPLY VPPH
PROGRAM ALL
BYTES TO 00H
INITIALIZE
ADDRESS
INITIALIZE
PLSCNT = 0
BUS
OPERATION COMMAND
STANDBY
COMMENTS
VPP RAMPS TO VPPH
(OR VPP HARDWIRED)
ALL BYTES SHALL BE
PROGRAMMED TO 00
BEFORE AN ERASE
OPERATION
INITIALIZE ADDRESS
PLSCNT = PULSE COUNT
A0H
WRITE ERASE
SETUP COMMAND
WRITE ERASE
COMMAND
TIME OUT 10ms
WRITE ERASE
VERIFY COMMAND
TIME OUT 6 μ s
WRITE
WRITE
WRITE
ERASE
ERASE
ERASE
VERIFY
ACTUAL ERASE
DATA = 20H
NEEDS 10ms PULSE,
DATA = 20H
DATA = 20H
WAIT
ADDRESS = BYTE TO VERIFY
20H;
DATA = 40H;
STOPS ERASE OPERATION
WAIT
INCREMENT
ADDRESS
READ DATA
FROM DEVICE
NO
READ
READ BYTE TO
VERIFY ERASURE
DATA =
FFH?
NO
INC PLSCNT
3000
= 1000 ?
STANDBY
COMPARE OUTPUT TO FF
INCREMENT PULSE COUNT
YES
YES
NO
LAST
ADDRESS?
YES
WRITE READ
COMMAND
WRITE
READ
DATA = 00H
RESETS THE REGISTER
FOR READ OPERATION
APPLY VPPL
ERASURE
COMPLETED
APPLY VPPL
ERASE
ERROR
STANDBY
VPP RAMPS TO VPPL
(OR VPP HARDWIRED)
Note:
(1) The algorithm MUST BE FOLLOWED to ensure proper and reliable operation of the device.
Doc. No. MD-1084, Rev. K
10
? 2009 SCILLC. All rights reserved.
Characteristics subject to change without notice
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